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工作職責(zé):
1、負(fù)責(zé)從Netlist到GDSII的物理設(shè)計(jì)全流程，包括布局布線、電源規(guī)劃、時鐘樹生成、靜態(tài)時序分析、物理驗(yàn)證、電源網(wǎng)絡(luò)分析和低功耗設(shè)計(jì)檢查等；
2、解決設(shè)計(jì)中的時序/擁塞/電壓降/電遷移等問題；
3、有機(jī)會接觸多種不同的設(shè)計(jì)、參與頂層相關(guān)工作，比如全芯片的布局規(guī)劃以及物理模塊劃分、Singoff工作等；
4、解決模塊的時序/擁塞/電壓降電遷移等問題；
5、研究先進(jìn)工藝特點(diǎn)，開發(fā)新的物理設(shè)計(jì)流程。
任職資格:
1、電子/微電子/通信等相關(guān)專業(yè)，碩士及以上學(xué)歷；
2、了解芯片設(shè)計(jì)實(shí)現(xiàn)流程；
3、熟悉集體管電路結(jié)構(gòu)者優(yōu)先，熟悉數(shù)字后端自動布局布線流程者優(yōu)先，有物理設(shè)計(jì)相關(guān)經(jīng)驗(yàn)者優(yōu)先；
4、熟悉Cadence /Synopsys PR工具的使用者優(yōu)先；
5、熟悉Verilog語言，熟悉Makefile/Tcl/Perl等腳本語言開發(fā)者優(yōu)先；
6、有良好的英語閱讀和書面溝通能力，具備認(rèn)真細(xì)致、積極主動的工作態(tài)度和良好的團(tuán)隊(duì)合作能力。